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AI 聚合热点事件 · 2026/10/29

Qwenputer 发布：在 Qwen3.5 权重内编译确定性 RISC-V CPU

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研究人员 Divyansh Agrawal 推出实验性模型 Qwenputer，将完整的 RISC-V CPU 逻辑直接编译进 Qwen 3.5 4B 的权重中。该架构利用 Gated DeltaNet 注意力层作为 RAM，使模型能在前向传播内部独立执行算术运算及 C/MicroPython 代码，无需任何外部运行时或工具调用。

最新动向/研究人员 Divyansh Agrawal 推出实验性模型 Qwenputer，将完整的 RISC-V CPU 逻辑直接编译进 Qwen 3.5 4B 的权重中。该架构利用 Gated DeltaNet 注意力层作为 RAM，使模型能在前向传播内部独立执行算术运算及 C/MicroPython 代码，无需任何外部运行时或工具调用。

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    Qwenputer 发布：在 Qwen3.5 权重内编译确定性 RISC-V CPU

    原标题：Qwenputer: A functioning, deterministic RISC-V CPU inside Qwen3.5

    • 核心创新在于将 RISC-V CPU 指令集与状态机逻辑硬编码至神经网络权重，实现纯内生计算。
    • 利用 Gated DeltaNet (GDN) 层的线性注意力特性模拟随机存取存储器 (RAM)，突破传统 Transformer 内存限制。
    • 衍生研究指出此类混合架构可能隐藏推理过程以规避思维链 (CoT) 监控，同时也为构建不可篡改的内部监管工具提供了新思路。